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Verilog HDL 快速入门FPGA超级干货第一季

jackzou / 2416人阅读

摘要:废话不多说,直接上菜,干饭目录一超级干货第一季模块时延数据流描述方式行为描述方式结构化描述形式混合设计描述方式设计模拟总结一超级干货第一季模块设计的数据流行为使用连续赋值语句进行描述时序行为使用过程结构描述。

废话不多说,直接上菜,干饭


一、FPGA超级干货第一季





1.模块

  设计的数据流行为使用连续赋值语句进行描述 ; 时序行为使用过程结构描述。一个模块可以在另一个模块中使用。
  说明部分用于定义不同的项,例如模块描述中使用的寄存器和参数。语句定义设计的功能和结构。说明部分和语句可以散布在模块中的任何地方;但是变量、寄存器、线网和参数等的说明部分必须在使用前出现。

建模一个半加器电路的模块的简单实例

module HalfAdder (A<

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jackzou

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